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进一步分析发现，当我开始这个项目时，我更喜欢Verilog，最初只用SpinalHDL从VexRiscv的Scala源代码生成Verilog模块。然而在过去两年里，我越来越多地使用SpinalHDL，现在甚至在编写自己的模块时，也倾向于使用它而不是Verilog。
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